產(chǎn)品搜索
型號(hào) | 差分輸入 | 記錄長(zhǎng)度 | 報(bào)價(jià) | 在線訂購(gòu)或獲取報(bào)價(jià) |
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TLA7SA08 | 8 | 每路差分輸入 160M 符號(hào);4 GB 物理內(nèi)存 | 聯(lián)系我們 | 配置并報(bào)價(jià) |
TLA7SA16 | 16 | 每路差分輸入 160M 符號(hào);8 GB 物理內(nèi)存(對(duì)于 x16 配置為 16 GB 物理內(nèi)存) | 聯(lián)系我們 | 配置并報(bào)價(jià) |
功能 |
優(yōu)勢(shì) |
OpenEYE 均衡 | OpenEYE 技術(shù)帶有自動(dòng)調(diào)節(jié)均衡電路,可讓您在總線任何位置進(jìn)行探測(cè) |
ScopePHY 探測(cè) | 直接將任何信號(hào)傳輸至高帶寬示波器,很快讓您放心設(shè)置已經(jīng)正確、PCI 信號(hào)滿足探頭輸入要求 |
FastSYNC | 有保障的再同步時(shí)間 <12 FTS1 (PCIe2) 或 <4 FTS2 (PCIe3),不管**電源狀態(tài)管理性能的電氣空閑時(shí)間如何 |
數(shù)據(jù)存儲(chǔ)和硬件加速搜索 | 不論記錄長(zhǎng)度有多長(zhǎng),在任何碼型上數(shù)秒即可獲取數(shù)據(jù)和執(zhí)行搜索 |
**的觸發(fā)系統(tǒng) | 快速建立觸發(fā)定義,在鏈路上出現(xiàn)的*難檢 PCIe 事件上觸發(fā) |
**的數(shù)據(jù)視圖 | 從協(xié)議層到物理層,以****的方式洞察數(shù)據(jù)
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多總線相關(guān) | 通過(guò)邏輯分析儀的原有功能,實(shí)現(xiàn)多個(gè)總線(DDR、PCIe、QPI,等等)以及其他系統(tǒng)級(jí)活動(dòng)的完整系統(tǒng)級(jí)可視化 |
產(chǎn)品技術(shù)資料 | 探頭 | 說(shuō)明 | 在線訂購(gòu)或獲取報(bào)價(jià) |
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P67SA01S | PCIE3 串行,2 個(gè)差分輸入,x1,槽式內(nèi)插器探頭 | 配置并報(bào)價(jià) | |
P67SA01SD | PCIE3 串行,1 個(gè)差分輸入,焊接探頭 | 配置并報(bào)價(jià) | |
P67SA04S | PCIE3 串行,8 個(gè)差分輸入,x4,槽式內(nèi)插器探頭 | 配置并報(bào)價(jià) | |
P67SA08 | PCIE3 串行,8 個(gè)差分輸入,x4,Midbus 探頭 | 配置并報(bào)價(jià) | |
P67SA08G2 | PCIe 串行,8 個(gè)差分輸入,X4,Midbus 探頭用于 TLA7SAxx 模塊連接到 PCIe2 Midbus 封裝 | 配置并報(bào)價(jià) | |
P67SA08S | PCIE3 串行,16 個(gè)差分輸入,x8,槽式內(nèi)插器探頭 | 配置并報(bào)價(jià) | |
P67SA16 | PCIE3 串行,16 個(gè)差分輸入,x8,Midbus 探頭 | 配置并報(bào)價(jià) | |
P67SA16G2 | PCIE 串行,16 個(gè)差分輸入,X8,MIDBUS 探頭用于 TLA7SAXX 模塊連接到 PCIE2 MIDBUS 封裝 | 配置并報(bào)價(jià) | |
P67SA16S | PCIE3 串行,32 個(gè)差分輸入,x16,槽式內(nèi)插器探頭 | 配置并報(bào)價(jià) |
標(biāo)題 |
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PCI Express 3.0流量控制:概述PCI Express 3.0流量控制:使用TLA7SA00系列邏輯協(xié)議分析儀概述 |
PCI Express邏輯協(xié)議分析視頻看看怎樣使用TLA7SA00驗(yàn)證和調(diào)試Gen1、Gen2或Gen3 PCI Express系統(tǒng)。執(zhí)行協(xié)作調(diào)試,迅速找到系統(tǒng)問(wèn)題的根源。 |
多種解決方案迎接嵌入式系統(tǒng)設(shè)計(jì)挑戰(zhàn)網(wǎng)上研討會(huì)(英)在本教程中,我們考察了改善嵌入式系統(tǒng)驗(yàn)證和調(diào)試效率的多種方式。**部分重點(diǎn)改善早期設(shè)計(jì)周期的工作效率,**部分重點(diǎn)介紹實(shí)驗(yàn)室中可以利用的節(jié)約時(shí)間、改善效率的技巧。
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簡(jiǎn)化Xilinx和Altera FPGA調(diào)試網(wǎng)絡(luò)研討會(huì)在本網(wǎng)絡(luò)研討會(huì),您將學(xué)習(xí)到:
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